吃透Chisel语言.00.吃透Chisel语言系列教程目录
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刺激的新系列【吃透Chisel语言】来啦!
之前的Chisel教程系列基于Chisel-Bootcamp,跟下来大约需要两周的时间,本质上是个速成班。Chisel教程系列相比Chisel-Bootcamp少了FIRRTL相关的内容,但涉及的内容已经完全足够90%以上的Chisel开发者了。
但是那个系列有很严重的问题,虽然话题从最低级的组合逻辑到高级的自定义类型都有讲到,但是侧重于和Scala放到一起讨论,并没有像其他语言教程一样当做一个新的语言来教学。此外,该教材也并非面面俱到,很多Chisel中的特性没有体现出来,更像是方法论的教学。这样学下来也不是不可以,但是对于没有Scala和Verilog基础的人来说有些困难了。
所以我又开启了这个系列,希望尽可能覆盖所有Chisel开发者需要的内容。于是我在官网的文档中找到了“Explanations”章节,该部分以设计者的视角,从设计决策、历史因素和技术约束等角度对Chisel语言进行了详尽的阐述。粗略浏览了该章节的内容,我个人认为可以基于此和Chisel-book做一个适合初学者的系列,全程跟下来可能没有Chisel教程系列那么速成,但一定可以吃透Chisel语言。
本系列目录如下(持续更新中):
01.大家Verilog和VHDL用得好好的,为什么要整个Chisel语言出来???
02.磨刀不误砍柴工,Chisel+VS Code+Ubuntu/WSL2开发环境搭建与使用
03.写给Verilog转Chisel的开发者——以组合逻辑电路为例,对比Chisel和Verilog的基本语法(没有Verilog基础也可以看看)
08.Chisel基础(五)——Wire、Reg和IO,以及如何理解Chisel生成硬件
09.Chisel项目构建、运行和测试(一)——用sbt构建Chisel项目并运行
10.Chisel项目构建、运行和测试(二)——Chisel中生成Verilog代码&Chisel开发流程
11.Chisel项目构建、运行和测试(三)——Chisel测试之ScalaTest
12.Chisel项目构建、运行和测试(四)——Chisel测试之ChiselTest
13.Chisel项目构建、运行和测试(五)——Chisel测试之波形测试(Waveform)和printf调试大法
14.Chisel模块详解(一)——初识Chisel模块(Module)并实现一个计数器
15.Chisel模块详解(二)——Chisel模块嵌套和ALU实现
16.Chisel模块详解(三)——Chisel的整体连接(Bulk Connection),以流水线处理器为例
18.Chisel模块详解(五)——Chisel中使用Verilog模块
19.Chisel组合电路(一)——Chisel组合电路与Chisel条件语句
20.Chisel组合电路(二)——Chisel编码器与解码器实现
21.Chisel时序电路(一)——Chisel寄存器(Register)详解
22.Chisel时序电路(二)——Chisel计数器(Counter)详解:计数器、定时器和脉宽调制
23.Chisel时序电路(三)——Chisel移位寄存器(Shift Register)详解
24.Chisel时序电路(四)——Chisel内存(Memory)详解
25.Chisel进阶之输入信号处理(一)——异步输入与去抖动
26.Chisel进阶之输入信号处理(二)——多数表决器滤波、函数抽象和异步复位
27.Chisel进阶之有限状态机(一)——基本有限状态机(Moore机)
28.Chisel进阶之有限状态机(二)——Mealy状态机及与Moore状态机的对比
29.Chisel进阶之通信状态机(一)——通信状态机:以闪光灯为例
30.Chisel进阶之通信状态机(二)——FSMD:以Popcount为例
31.Chisel进阶之通信状态机(三)——Ready-Valid接口:定义、时序和Chisel中的实现
32.Chisel进阶之硬件生成器(一)——Chisel中的参数化
33.Chisel进阶之硬件生成器(二)——Chisel组合逻辑电路生成:以BCD编码表为例
34.Chisel进阶之硬件生成器(三)——利用面向对象编程特性:以Ticker为例
35.Chisel进阶之硬件生成器(四)——利用函数式编程特性
36.Chisel实战之以FIFO为例(一)——FIFO Buffer和Bubble FIFO的Chisel实现
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